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集成電路設(shè)計(jì)實(shí)驗(yàn)教程

集成電路設(shè)計(jì)實(shí)驗(yàn)教程

作者：趙武
出版社：西安電子科技大學(xué)出版社出版時(shí)間：2015-02-01
開(kāi)本： 16開(kāi) 頁(yè)數(shù)： 224
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集成電路設(shè)計(jì)實(shí)驗(yàn)教程 版權(quán)信息

集成電路設(shè)計(jì)實(shí)驗(yàn)教程 內(nèi)容簡(jiǎn)介

本書(shū)分為上下兩篇。上篇介紹模擬集成電路圖編輯與電路仿真、版圖設(shè)計(jì)與驗(yàn)證(包括DRC、LVS、LPE和后仿真等)及其他高級(jí)仿真技術(shù)等；下篇介紹VLSI的設(shè)計(jì)流程以及邏輯仿真、邏輯綜合、靜態(tài)時(shí)序分析、版圖綜合、自動(dòng)測(cè)試向量生成和形式驗(yàn)證等實(shí)用技術(shù)。

集成電路設(shè)計(jì)實(shí)驗(yàn)教程 目錄

上篇 模擬集成電路設(shè)計(jì)第1章 模擬IC設(shè)計(jì)概述1.1 模擬IC設(shè)計(jì)流程1.2 Cadence模擬IC設(shè)計(jì)軟件概述及模塊功能介紹1.3 Calibre版圖驗(yàn)證工具簡(jiǎn)介1.4 Cadence的help文檔使用第2章 運(yùn)行Cadence與建立庫(kù)2.1 建立個(gè)人工作目錄2.2 啟動(dòng)Cadence之前的準(zhǔn)備工作2.3 啟動(dòng)Cadence2.4 添加已有設(shè)計(jì)庫(kù)2.5 建立個(gè)人工作庫(kù)第3章 電路圖輸入——Composer3.1 新建電路圖3.2 添加元件3.3 放置端口3.4 設(shè)置元件參數(shù)3.5 檢查并存儲(chǔ)3.6 打印輸出3.7 電路圖輸入常用快捷鍵第4章 創(chuàng)建Symbol視圖4.1 創(chuàng)建電路圖的Symbol4.2 編輯Symbol第5章 電路仿真-ADE5.1 建立仿真電路5.2 仿真環(huán)境設(shè)置5.3 運(yùn)行仿真及Calculator的使用第6章 電路仿真實(shí)驗(yàn)示例6.1 二極管特性仿真6.2 BJT晶體管的I-V特性仿真6.3 MOS晶體管I-V特性仿真6.4 簡(jiǎn)單MOS差動(dòng)放大器仿真6.5 設(shè)計(jì)練習(xí)第7章 版圖設(shè)計(jì)-Assura Virtuoso7.1 新建Layout7.2 設(shè)置LSW可見(jiàn)層7.3 繪制PMOS管7.4 繪制NMOS管7.5 信號(hào)線的連接7.6 連接電源與地線7.7 做襯底接觸7.8 放置Pin7.9 版圖輸入常用快捷鍵第8章 設(shè)計(jì)規(guī)則檢查-Assura DRC8.1 設(shè)置并運(yùn)行DRC8.2 查找DRC錯(cuò)誤并修改8.3 其他DRC功能第9章 版圖與原理圖一致性檢查- Assura LVS9.1 設(shè)置并運(yùn)行LVS9.2 查找LVS錯(cuò)誤并修改第10章 寄生參數(shù)提取-Assura RCX10.1 設(shè)置并運(yùn)行RCX10.2 查看RCX結(jié)果第11章 層次化管理與后仿真11.1 建立Configuration View與運(yùn)行Hierarchy管理器11.2 前仿真11.3 后仿真第12章 模擬IC綜合實(shí)驗(yàn)12.1 兩級(jí)運(yùn)算放大器(OPA)設(shè)計(jì)12.2 帶隙基準(zhǔn)仿真-應(yīng)用工藝角仿真工具 下篇 數(shù)字集成電路設(shè)計(jì)第13章 ASIC設(shè)計(jì)概述13.1 ASIC設(shè)計(jì)流程13.2 ASIC設(shè)計(jì)軟件13.3 腳本文件與Tcl語(yǔ)法第14章 邏輯仿真-ModelSim14.1 基本使用步驟14.2 ModelSim的不同窗口及功能介紹14.3 功能仿真與時(shí)序仿真14.4 ModelSim的高級(jí)功能14.5 練習(xí)…… 參考文獻(xiàn)
展開(kāi)全部
暫無(wú)評(píng)論……
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