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FPGA應(yīng)用技術(shù)及實踐(第3版)

FPGA應(yīng)用技術(shù)及實踐(第3版)

作者：劉睿強
出版社：北京理工大學(xué)出版社出版時間：2019-09-01
開本： 16開 頁數(shù)： 268
中 圖 價:¥24.5(3.6折) 定價  ¥68.0 登錄后可看到會員價
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FPGA應(yīng)用技術(shù)及實踐(第3版) 版權(quán)信息

FPGA應(yīng)用技術(shù)及實踐(第3版) 內(nèi)容簡介

本書以全球著名的可編程邏輯器件供應(yīng)商Xilinx公司的產(chǎn)品為背景，介紹該公司的CPLD/FPGA產(chǎn)品的結(jié)構(gòu)原理、性能特點、設(shè)計方法以及相應(yīng)的EDA工具軟件。內(nèi)容包括：EDA技術(shù)概述、可編程邏輯器件及FPGA開發(fā)簡介、基于ISE的開發(fā)環(huán)境使用指南、第三方工具介紹、簡單數(shù)字邏輯電路的設(shè)計、EDA技術(shù)綜合設(shè)計應(yīng)用、基于FPGA的嵌入式系統(tǒng)開發(fā)。

FPGA應(yīng)用技術(shù)及實踐(第3版) 目錄

第1章 EDA技術(shù)概述 1.1 EDA技術(shù)及其發(fā)展 1.1.1 EDA技術(shù)的含義 1.1.2 EDA技術(shù)的發(fā)展歷程 1.2 .EDA技術(shù)的主要內(nèi)容 1.2.1 自頂向下的設(shè)計方法 1.2.2 ASIC設(shè)計 1.2.3 硬件描述語言 1.2.4 主要PLD廠商概述 1.3 常用的EDA工具 1.3.1 設(shè)計輸入編輯器 1.3.2 HDL綜合器 1.3.3 仿真器 1.3.4 適配器 1.3.5 下載器 1.4 EDA設(shè)計流程 1.4.1 設(shè)計輸入 1.4.2 綜合 1.4.3 適配 1.4.4 時序仿真與功能仿真 1.4.5 編程下載 1.4.6 硬件測試 1.5 EDA技術(shù)的發(fā)展趨勢 1.6 EDA技術(shù)的應(yīng)用 1.6.1 EDA技術(shù)的應(yīng)用形式 1.6.2 EDA技術(shù)的應(yīng)用場合 本章小結(jié) 思考與練習(xí) 第2章 可編程邏輯器件及FPGA開發(fā)簡介 2.1 可編程邏輯器件基礎(chǔ) 2.1.1 可編程邏輯器件簡介 2.1.2 可編程邏輯器件的發(fā)展歷史 2.1.3 可編程邏輯器件的基本結(jié)構(gòu) 2.1.4 可編程邏輯器件的分類 2.2 CPLD的基本結(jié)構(gòu)及特點 2.3 FPGA的基本結(jié)構(gòu)及特點 2.4 FPGA和CPLD的性能比較和開發(fā)應(yīng)用選擇 2.4.1 FPGA和CPLD的性能比較 2.4.2 FPGA和CPLD的開發(fā)應(yīng)用選擇 2.5 Xilinx新型系列器件簡介 2.5.1 Spartan系列 2.5.2 Virtex系列 本章小結(jié) 思考與練習(xí) 第3章 基于ISE的開發(fā)環(huán)境使用指南 3.1 ISE的安裝與基本操作 3.1.1 ISE軟件介紹 3.1.2 ISE軟件的安裝 3.1.3 ISE軟件的基本操作 3.2 ISE的工程建立與設(shè)計輸入 3.2.1 ISE的工程建立 3.2.2 基于ISE的HDL代碼輸入 3.2.3 基于ISE代碼模板的使用 3.2.4 基于ISE的原理圖輸入法 3.2.5 基于ISE的IP Core的使用 3.3 基于ISE的仿真 3.4 基于ISE的綜合與實現(xiàn) 3.4.1 基于Xilinx XST的綜合 3.4.2 基于ISE的實現(xiàn) 3.5 FPGA配置與編程 3.5.1 Xilinx FPGA配置電路綜述 3.5.2 iMPACT的基本操作 3.5.3 使用iMPACT創(chuàng)建配置文件 3.6 約束文件的編寫 3.6.1 約束文件的定義 3.6.2 UCF文件的語法說明 3.6.3 ISE中UCF文件的編寫 3.7 集成化邏輯分析儀 3.7.1 Chipscope Pro(集成化邏輯分析工具)簡介 3.7.2 Chipscope Pro的使用流程 3.7.3 Chipscope Pro Inserter的操作和使用 3.7.4 Chipscope Pro邏輯分析儀使用流程 本章小結(jié) 思考與練習(xí) 第4章 第三方工具介紹 4.1 Modelsim SE 6.2 軟件的使用 4.1.1 Modelsim SE 6.2 軟件的安裝 4.1.2 利用Modelsim進行功能仿真 4.1.3 利用Modelsim進行時序仿真 4.2 Synplify Pro軟件的使用 4.2.1 Synplify Pro 9.0.1軟件的安裝 4.2.2 Synplify Pro 9.0.1軟件的使用 本章小結(jié) 思考與練習(xí) 第5章 簡單數(shù)字邏輯電路的設(shè)計 5.1 基于Xilinx FPGA的組合邏輯電路設(shè)計 5.1.1 基本邏輯門電路設(shè)計 5.1.2 編碼器設(shè)計 5.1.3 譯碼器設(shè)計 5.1.4 數(shù)值比較器設(shè)計 5.1.5 數(shù)據(jù)選擇器設(shè)計 5.1.6 總線緩沖器設(shè)計 5.2 時序邏輯電路設(shè)計 5.2.1 時鐘信號和復(fù)位信號 5.2.2 觸發(fā)器設(shè)計 5.2.3 移位寄存器 5.2.4 計數(shù)器設(shè)計 5.2.5 分頻器設(shè)計 5.3 存儲器設(shè)計 5.3.1 只讀存儲器ROM 5.3.2 隨機存儲器RAM 5.3.3 FIFO的設(shè)計 5.4 有限狀態(tài)機設(shè)計 5.4.1 有限狀態(tài)機原理 5.4.2 有限狀態(tài)機分類 5.4.3 有限狀態(tài)機設(shè)計方法 本章小結(jié) 思考與練習(xí) 第6章 EDA技術(shù)綜合設(shè)計應(yīng)用 6.1 實驗一基本邏輯門設(shè)計 6.2 實驗二基于原理圖的基本邏輯門設(shè)計 6.3 實驗三4選1數(shù)據(jù)選擇器設(shè)計 6.4 實驗四7人表決器設(shè)計 6.5 實驗五用Verilog HDL設(shè)計4人搶答器 6.6 實驗六基于IP核的4位乘法器設(shè)計 6.7 實驗七帶復(fù)位端的同步分頻器設(shè)計 6.8 實驗八移位寄存器設(shè)計 6.9 實驗九有限狀態(tài)機設(shè)計 6.10 實驗十有限狀態(tài)機控制流水燈 6.11 實驗十一時鐘及數(shù)碼管驅(qū)動實驗 6.12 實驗十二4×4矩陣鍵盤實驗 第7章 基于FPGA的嵌人式系統(tǒng)開發(fā) 7.1 可編程嵌入式系統(tǒng)介紹 7.1.1 基于FPGA的嵌入式系統(tǒng) 7.1.2 Xilinx公司的嵌入式解決方案 7.2 EDK簡介 7.2.1 EDK介紹 7.2.2 EDK設(shè)計的實現(xiàn)流程 7.2.3 EDK的文件管理架構(gòu) 7.3 XPS的基本操作 7.3.1 利用BSB創(chuàng)建新工程 7.3.2 XPS的用戶界面 7.4 XPS的 操作 7.4.1 XPS的軟件輸入 7.4.2 XPS工程的實現(xiàn)和下載 7.5 EDK開發(fā)實例 7.5.1 DDR SDRAM控制器的工作原理 7.5.2 DDR SDRAM控制器的基本要求 7.5.3 DDR SDRAM控制器的EDK實現(xiàn) 本章小結(jié) 思考與練習(xí) 附錄 部分實驗Verilog HDL代碼 參考文獻
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FPGA應(yīng)用技術(shù)及實踐(第3版) 作者簡介

劉睿強，男，副教授，重慶市中青年骨 。主持了 、 職業(yè)教育半導(dǎo)體照明技術(shù)與應(yīng)用專業(yè)教學(xué)資源庫子項目《光電顯示技術(shù)》等3項；主研了《表面貼裝與工藝實施》等4門省級精品課程、精品資源共享課程；主持了《FPGA應(yīng)用技術(shù)及實踐》2門校級精品課程，主講了《EDA技術(shù)與應(yīng)用實踐》2門校級精品資源共享課；主持了省級《數(shù)字電子技術(shù)》在線開發(fā)課程。主持了 、 “十二五”規(guī)劃重點課題“微電子科學(xué)與工程”職教師資素質(zhì)提高計劃子項目《微電子科學(xué)與工程》專業(yè)職教師資本科培養(yǎng)培養(yǎng)質(zhì)量評價體系。主持、主研了重慶市教委科學(xué)技術(shù)研究項目“數(shù)值模擬射頻脈沖高氣壓氣體放電研究”等課題17項。獲中國電子教育學(xué)會教學(xué)成果一等獎等7項。指導(dǎo)學(xué)生參加全國大學(xué)生電子設(shè)計競賽獲一等獎，全國職業(yè)院校技能大賽一等獎等各級獎項10余次。

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